PG电子官方网站干系钻研事情获取国度天然科学基金项目、华为本事有限公司、上海思尔芯本事股份有限公司等校企配合项目资帮，干系结果运用于我国硬件仿真器研发。

　　硬件仿真器（EMU）是仿真验证中的根底性 EDA 东西，硬件编译本事则是硬件仿真器研发的要害硬件。课题组面向 FPGA、专用 CPU 等两种本事门途的 EMU 中电途划分，求解经典的超图划分 N-P 困难目规模，革新提出了面向多 FPGA 体例、统治器调理驱动的电途划分框架，完毕了数十亿范畴的超图划分高效优化求解，获得了干系结果。

　　该法子通过将大范畴电途依照拓扑序平衡度实行高效地聚类，高明地行使电途节点的维系度和拓扑平衡度获取初始结果，进而正在每一层睁开电途前实行有用地改良，完毕了编译流程中的高质料划分。

　　这一革新性法子不只添补了调理驱动的电途划分偏向的钻研空缺，也为高机能的硬件仿真供给了紧要钻研思绪。

　　该事情的第一作家为集成电途学部 2022 级博士钻研生毕舜阳，西安电子科技大学为第一达成单元，游海龙教学为通信作家。

　　为治理因多 FPGA 体例拓扑硬件硬件、TDM 等要素导致划分后电途时序机能降落的题目，钻研团队正在MaPart: An Efficient Multi-FPGA System-Aware Hypergraph Partitioning Framework论文中革新性地提出了一个零违例的高效划分器 TopoPart+，该划分器被集成正在一个二分查找的算法框架中，完毕最幼 hop 的初始划分计划，进而正在拓扑感知和堵塞途途驱动的改良下获得细化的高质料划分结果硬件。

　　为管造布线阶段的 hop 的延时，团队还高明地连系分层图思念完毕了布线算法。这一系列冲破性的事情极大地提拔了电途仿真通常序机能，显露了正在时序驱动的划分的紧要希望。

　　论文供给了一种取消违例的候选 FPGA 传布算法，连系高效的划分算法，该计划最终可完毕多 FPGA 体例划分后零违例的标的，潜正在提拔了编译的时序机能，为完毕高机能硬件仿真和原型验证方面供给了雄伟运用远景硬件。

　　该事情的第一作家为集成电途学部 2020 级博士钻研生李本正，游海龙教学为通信作家，西安电子科技大学为第一达成单元。

　　国际筹划机辅帮安排集会（ICCAD）和欧洲安排、自愿化与测试集会 (DATE) 是 EDA 规模水准最高的国际集会之一，是中国筹划机学会（CCF）推举的筹划机编造构造与高机能筹划偏向顶级国际学术集会，集会每年作品投稿量近千篇，每年的罗致率为 20%-25%。

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